OR 함수

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입력의 논리적 OR을 계산합니다. 두 입력은 불리언 값, 숫자형 값 또는 에러 클러스터여야 합니다. 입력이 모두 거짓인 경우, 함수는 거짓을 반환합니다. 그렇지 않은 경우, 참을 반환합니다.

노트 이 함수는 숫자 입력에 대해 비트 단위 연산을 수행합니다.

커넥터 팬은 이 다형성 함수의 기본 데이터 타입을 디스플레이합니다.

입력/출력

x —

x는 반드시 불리언 값 또는 숫자여야 합니다. x는 스칼라, 숫자 또는 불리언 값의 배열 또는 클러스터, 숫자 또는 불리언 값의 클러스터의 배열 등이 될 수 있습니다. x가 에러 클러스터인 경우, 에러 클러스터의 상태 파라미터만 입력 터미널에 전달됩니다.

y —

y는 반드시 불리언 값 또는 숫자여야 합니다. y는 스칼라, 숫자 또는 불리언 값의 배열 또는 클러스터, 숫자 또는 불리언 값의 클러스터의 배열 등이 될 수 있습니다. y가 에러 클러스터인 경우, 에러 클러스터의 상태 파라미터만 입력 터미널에 전달됩니다.

x .or. y? —

x .or. y?는 x와 y의 논리적 OR입니다.

다음 세부사항은 FPGA VI에서 이 객체를 사용할 때 적용됩니다.

노트 다음 세부사항은 각 LabVIEW FPGA Module 버전에 따라 변경될 수 있습니다.


Single-Cycle Timed 루프	지원함.
Usage	시간과 리소스 효율성을 극대화하려면, 단일 사이클 Timed 루프 내부에서 불리언 함수를 사용합니다.
타이밍	단일 사이클 Timed 루프 내부--단일 사이클 Timed 루프 내부에서 불리언 함수를 사용할 때 각 불리언 작업은 단일 사이클 Timed 루프의 조합 로직 지연에 약간 추가됩니다. 단일 사이클 Timed 루프 외부--단일 사이클 Timed 루프 외부에서 불리언 함수를 사용할 때 각 불리언 작업은 하나의 클럭 사이클이 필요합니다.
리소스	불리언 함수는 큰 배열을 입력에 연결하는 경우에만 상당한 FPGA 리소스를 사용합니다. FPGA 리소스를 절약하기 위해 스토리지 제한을 고려하십시오.

LabVIEW에 포함된 다음 예제 파일을 참조하십시오.