Deaktivierungsstruktur
- Aktualisiert2023-02-17
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Deaktivierungsstruktur
Enthält ein oder mehrere Unterdiagramme (oder Cases), von denen jeweils das aktivierte Unterdiagramm ausgeführt wird. Sie können mit Hilfe der Schaltfläche Bedingung für aktives Unterdiagramm bearbeiten auf der Registerkarte Objekt Unterdiagramme bedingt deaktivieren.
Ein-/Ausgänge
Unterdiagramm-Selektor
Teil der Struktur, die den Wert bzw. die Werte anzeigt, für die das zugehörige Unterdiagramm ausgeführt wird.

Tunnel
Punkt im Rahmen einer Struktur, durch den Daten fließen.

Examples
Suchen Sie in der Programmierumgebung nach den folgenden installierten Beispielen:- Deaktivierungsstruktur
Deaktivieren von Unterdiagrammen unter einer bestimmten Bedingung
Wählen Sie Bedingung für aktives Unterdiagramm bearbeiten auf der Registerkarte Objekt aus, um mindestens eine Bedingung festzulegen, unter welcher ein Unterdiagramm in der Deaktivierungsstruktur aktiviert werden soll. Sie können z. B. für Programmcode, der nur auf einem bestimmten Zielsystem ausgeführt werden soll, ein Unterdiagramm bedingt aktivieren.
In der nachfolgenden Tabelle finden Sie eine Liste von verfügbaren Zustandssymbolen und ihren Werten.
| Zustandssymbol | Gültige Werte | Beschreibung |
|---|---|---|
| CPU |
|
Der Prozessor, auf dem das Unterdiagramm ausgeführt werden soll. |
| OS |
|
Das Betriebssystem, auf dem das Unterdiagramm ausgeführt werden soll. |
| TARGET_BITNESS |
|
Die Bitanzahl der Anwendung, die das Unterdiagramm ausführt. |
| TARGET_TYPE |
|
Die Plattformen oder Zielsysteme, auf denen das Unterdiagramm ausgeführt wird. |
Gültige Zustandssymbole für FPGA-Zielsysteme
Die folgenden Symbole können nur in einem VI verwendet werden, das auf einem FPGA-Zielsystem ausgeführt wird.
| Zustandssymbol | Gültige Werte | Beschreibung |
|---|---|---|
| TARGET_TYPE |
|
Die Plattformen oder Zielsysteme, auf denen das Unterdiagramm ausgeführt wird. |
| FPGA_TARGET_FAMILY |
|
Die FPGA-Familie, auf der das Unterdiagramm ausgeführt werden soll |
| FPGA_TARGET_EXECUTION |
|
Der Speicherort, der sich entweder auf einem FPGA-Zielsystem oder auf dem Entwicklungscomputer befindet, auf dem das Unterdiagramm in der Simulation ausgeführt wird. |
| FPGA_TARGET_CLASS |
|
Die Klasse des FPGA-Zielsystems, auf dem das Unterdiagramm ausgeführt wird. |