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CDL

版本:
    更新: 2018年3月22日

    CDL允许用户创建可在一个时钟周期内执行的代码,执行速率为指定的CDL循环速率。 由于编译时代码直接映射到FPGA上的资源,同时还依赖于CDL循环的定时,CDL代码只能在FPGA终端上VI程序框图的CDL循环内运行。

    编程时需要在两个地方使用CDL。

    1. 直接在CDL循环内。
    2. CDL循环中的CDL文档(.gcdl)或子CDL内。
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    注:  

    CDL选板上的部分节点只能在CDL循环或CDL文档内运行。如将此类节点添加至循环外部,“错误和警告”选项卡会显示错误。


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